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4.1. Intel® Agilex™ 高速SERDES I/O概述
4.2. 使用LVDS SERDES Intel FPGA IP实现高速LVDS I/O
4.3. Intel® Agilex™ LVDS SERDES发送器
4.4. Intel® Agilex™ LVDS SERDES接收器
4.5. LVDS SERDES IP初始化和复位
4.6. External PLL模式的 Intel® Agilex™ LVDS接口
4.7. Intel® Agilex™ LVDS SERDES源同步时序预算
4.8. LVDS SERDES IP时序
4.9. LVDS SERDES IP设计实例
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5.1.3. OCT校准模块要求
如果使能OCT校准,那么必须使用同一OCT校准模块对同一I/O通道中的I/O进行校准。
在 Intel® Quartus® Prime Settings File (.qsf)中,指定以下RZQ分组分配(grouping assignment),对一个I/O管脚分配一个RZQ管脚。Fitter将分配给同一RZQ管脚的所有管脚组合在一起,并创建一个OCT模块来校准I/O管脚:set_instance_assignment -name RZQ_GROUP oct_rzq_in -to output_pin。