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2.3.1. 协议预置
2.3.2. GXT通道
2.3.3. 常规参数和数据通道参数
2.3.4. PMA参数
2.3.5. PCS-Core接口参数
2.3.6. 模拟PMA设置参数
2.3.7. Enhanced PCS参数
2.3.8. Standard PCS参数
2.3.9. PCS Direct数据通路参数
2.3.10. 动态重配置参数
2.3.11. 生成选项参数
2.3.12. PMA,校准和复位端口
2.3.13. PCS-Core接口端口
2.3.14. 增强PCS端口
2.3.15. 标准PCS端口
2.3.16. 收发器PHY PCS-to-Core接口参考端口映射
2.3.17. IP Core文件位置
2.5.1.1. PIPE的收发器通道数据通路
2.5.1.2. 支持的PIPE特性
2.5.1.3. 如何连接PIPE Gen1、Gen2和Gen3模式的TX PLL
2.5.1.4. 如何在 Intel® Stratix® 10收发器中实现PCI Express (PIPE)
2.5.1.5. PIPE的Native PHY IP Core参数设置
2.5.1.6. 用于PIPE的fPLL IP Core参数设置
2.5.1.7. 用于PIPE的ATX PLL IP Core参数设置
2.5.1.8. 用于PIPE的Native PHY IP Core端口
2.5.1.9. 用于PIPE的fPLL端口
2.5.1.10. 用于PIPE的ATX PLL端口
2.5.1.11. 到TX去加重的预置映射(Preset Mappings to TX De-emphasis)
2.5.1.12. 如何对PIPE配置布局通道
2.5.1.13. Gen3的链路均衡
2.5.1.14. 时序收敛建议
6.1. 重配置通道和PLL模块
6.2. 与重配置接口进行交互
6.3. 多个重配置设置文件(Multiple Reconfiguration Profiles)
6.4. 仲裁(arbitration)
6.5. 动态重配置的建议
6.6. 执行动态重配置的步骤
6.7. 直接重配置流程
6.8. Native PHY IP或PLL IP Core指导的重配置流程
6.9. 特殊情况的重配置流程
6.10. 更改模拟PMA设置
6.11. 端口和参数
6.12. 多个IP模块之间的动态重配置接口合并
6.13. 嵌入式调试功能
6.14. 时序收敛建议
6.15. 不支持的功能
6.16. 收发器寄存器映射
6.17. 重配置接口和动态重配置修订历史
7.5.1. 重新校准一个双工通道(PMA TX和PMA RX)
7.5.2. 仅在双工通道中重新校准PMA RX
7.5.3. 仅在双工通道中重新校准PMA TX
7.5.4. 在没有合并到同一物理通道的单工TX的情况下重新校准PMA单工RX
7.5.5. 在没有合并到同一物理通道的单工RX的情况下重新校准PMA单工TX
7.5.6. 仅重新校准单工TX合并的物理通道中的PMA单工RX
7.5.7. 仅重新校准单工RX合并的物理通道中的PMA单工TX
7.5.8. 重新校准fPLL
7.5.9. 重新校准ATX PLL
7.5.10. 当CMU PLL用作TX PLL时,重新校准CMU PLL
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6.9.2.1. ATX参考时钟切换
您可以使用 ATX PLL实例上的重配置接口来指定哪个参考时钟源驱动ATX PLL。 ATX PLL支持对五个不同的参考时钟源提供时钟(clocking)。
在执行参考时钟切换前,请确保ATX PLL实例定义多个参考时钟源。在ATX PLL参数化过程中请在PLL选项卡上指定Number of PLL reference clocks参数。
显露的pll_refclk端口的数量因指定的参考时钟数量而异。在此操作中,请使用ATX PLL重配置接口。
收发器ATX PLL端口 | 说明 | 地址 | 比特 |
---|---|---|---|
pll_refclk0 | 代表逻辑refclk0。查找寄存器x113[7:0]存储从逻辑refclk0到物理refclk的映射。 |
0x113 (Lookup Register) | [7:0] |
pll_refclk1 | 代表逻辑refclk1。查找寄存器x114[7:0]存储从逻辑refclk1到物理refclk的映射。 |
0x114 (Lookup Register) | [7:0] |
pll_refclk2 | 代表逻辑refclk2。查找寄存器 x115[7:0]存储从逻辑refclk2到物理refclk的映射。 |
0x115 (Lookup Register) | [7:0] |
pll_refclk3 | 代表逻辑refclk3。查找寄存器x116[7:0]存储从逻辑refclk3到物理refclk的映射。 | 0x116 (Lookup Register) | [7:0] |
pll_refclk4 | 代表逻辑refclk4。查找寄存器x117[7:0]存储从逻辑refclk4到物理refclk的映射。 | 0x117 (Lookup Register) | [7:0] |
N/A | ATX refclk选择MUX。 | 0x112 | [7:0] |
执行一个参考时钟切换时,必须指定查找寄存器地址和替换时钟相应的比特。确定ATX PLL后,请遵循以下步骤切换到所选的参考时钟:
- 在执行动态重配置的步骤中执行步骤1到10的必要步骤。
- 从查找寄存器地址中读取并保存所需的8-bit码型。例如:切换到逻辑refclk2需要使用地址0x115上的bits[7:0]。
- 使用从查找寄存器中获得的8-bit值对地址0x112上的bits[7:0]执行一个read-modify-write操作。
- 在执行动态重配置的步骤中执行步骤12到14的必要步骤。
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