仅对英特尔可见 — GUID: lbl1465424164077
Ixiasoft
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6.1.6.3. Hard IP状态接口
信号 |
方向 |
描述 |
---|---|---|
derr_cor_ext_rcv | 输出 |
置位后,表示RX缓冲器检测到一个1-bit(可纠正)ECC错误。此为脉冲拉伸输出(pulse stretched output)。 |
derr_cor_ext_rpl | 输出 |
置位后,表示重试缓冲器检测到一个1-bit(可纠正)ECC错误。此为脉冲拉伸输出(pulse stretched output)。 |
derr_rpl | 输出 |
置位后,表示重试缓冲器检测到一个2-bit(不可纠正)ECC错误。此为脉冲拉伸输出(pulse stretched output)。 |
derr_uncor_ext_rcv | 输出 |
置位后,表示RX缓冲器检测到一个2-bit(不可纠正)ECC错误。此为脉冲拉伸输出(pulse stretched output)。 |
int_status[10:0](用于H-Tile) Int_status[7:0](用于L-Tile) int_status_pf1[7:0](用于L-Tile) |
输出 |
Int_status[3:0]信号驱动应用程序的legacy中断(用于 H-Tile)。 int_status[10:4]信号提供其他中断的状态(用于H-Tile)。 Int_status[3:0]信号驱动PF0应用程序的legacy中断(用于L-Tile)。 int_status[7:4]信号提供PF0的其他中断的状态(用于L-Tile)。 Int_status[3:0]信号驱动PF1应用程序的legacy中断(用于L-Tile)。 int_status[7:4]信号提供PF0的其他中断的状态(用于L-Tile)。 以下信号定义为:
|
int_status_common[2:0] | 输出 |
指定以下寄存器的中断状态。置位后,表示中断挂起状态:
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lane_act[4:0] | 输出 |
Lane Active Mode:此信号表示链路训练期间配置的数据通路个数。以下编码定义为:
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link_up | 输出 |
置位时,链路开启。 |
ltssmstate[5:0] | 输出 |
Link Training and Status State Machine (LTSSM)状态:LTSSM状态机编码定义以下状态:
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rx_par_err | 输出 |
置位单个周期,表示在RX缓冲器输入的TLP中检测到1个奇偶校验错误。此错误被记录为VSEC寄存器中不可纠正的内部错误。请参阅Uncorrectable Internal Error Status Register(无法纠正的内部错误状态寄存器)了解更多信息。如果出现该错误,则必须复位Hard IP,因为奇偶校验错误会将Hard IP保持于未知状态。 |
tx_par_err | 输出 |
置位单个周期以表示TX TLP传送期间的奇偶校验错误。即便检测到奇偶校验错误,IP核也会发送TX TLP数据包。 |