仅对英特尔可见 — GUID: xae1503692705377
Ixiasoft
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10.2.1. PCIe* Link Inspector硬件
当使能 PCIe* Link Inspector时,生成的IP的altera_pcie_s10_hip_ast_pipen1b模块包括下图所示的 PCIe* Link Inspector。
从运行在单独的测试PC的System Console驱动 PCIe* Link Inspector。System Console通过Altera Debug Master Endpoint (ADME)连接到 PCIe* Link Inspector。 Intel® FPGA Download Cable进行此连接。
使能 PCIe* Link Inspector时, PCIe* IP的时钟hip_reconfig_clk和复位hip_reconfig_rst_n出现在顶层。这些信号对以下接口提供时钟和复位
- The ADME module
- fpll_reconfig
- atxpll_reconfig
- xcvr_reconfig
- hip_reconfig
您必须提供一个高达100 MHz的时钟源来驱动hip_reconfig_clk时钟。当在 Intel® Stratix® 10-GX Development Kit上运行一个动态生成的设计实例时,这些信号是自动连接的。
如果在您自己的硬件上运行 PCIe* Link Inspector,请务必将hip_reconfig_clk连接到一个100 MHz时钟源,并将hip_reconfig_rst_n连接到相应的复位信号。