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6.7.2. I/O AUX
每I/O列中有一个I/O AUX模块:
- 包含一个硬 Nios® II处理器,并且支持嵌入式存储器模块
- 处理整个I/O列的校准算法
- 通过专用 Avalon® 接口与每个I/O bank中的定序器进行通信
图 132. IO AUX结构图
硬 Nios® II处理器执行如下操作:
- 配置并开始定序器上的校准任务
- 收集和处理数据
- 使用最终结果来配置I/O
Nios® II代码和定序器的组合,该算法的实现可支持下列存储器接口标准的校准:
- DDR2、DDR3和DDR4 SDRAM
- QDR II和QDR IV SRAM
- RLDRAM 3
- LPDDR2和LPDDR3
注: Intel建议您将 Nios® 子系统用于存储器接口校准。