Intel® Stratix® 10通用I/O用户指南

下载 PDF
ID 683518
日期 7/09/2018
Public
文档目录
文档目录 x
1. Intel® Stratix® 10 I/O概述 2. Intel® Stratix® 10 I/O体系结构和功能 3. Intel® Stratix® 10 I/O设计考量 4. Intel® Stratix® 10 I/O实现指南 5. GPIO Intel® FPGA IP参考 6. Intel Stratix 10通用I/O用户指南存档 7. Intel® Stratix® 10通用I/O用户指南文件修订历史
1. Intel® Stratix® 10 I/O概述 x
1.1. Intel® Stratix® 10I/O和差分I/O缓冲器 1.2. Intel® Stratix® 10 I/O纵向移植支持
2. Intel® Stratix® 10 I/O体系结构和功能 x
2.1. Intel® Stratix® 10器件中的I/O标准和电压电平 2.2. Intel® Stratix® 10 器件中的I/O单元结构 2.3. Intel® Stratix® 10 器件中可编程IOE功能 2.4. Intel® Stratix® 10 器件的片上I/O匹配 2.5. Intel® Stratix® 10 器件的外部I/O匹配
2.1. Intel® Stratix® 10器件中的I/O标准和电压电平 x
2.1.1. Intel® Stratix® 10 I/O标准支持 2.1.2. Intel® Stratix® 10 I/O标准电压电平支持
2.2. Intel® Stratix® 10 器件中的I/O单元结构 x
2.2.1. Intel® Stratix® 10 器件的I/O Bank体系结构 2.2.2. Intel® Stratix® 10 器件的I/O缓冲器和寄存器
2.3. Intel® Stratix® 10 器件中可编程IOE功能 x
2.3.1. 可编程输出摆率控制 2.3.2. 可编程IOE延迟 2.3.3. 可编程开漏输出 2.3.4. 可编程总线保持 2.3.5. 可编程的上拉电阻器 2.3.6. 可编程预加重（Programmable Pre-Emphasis） 2.3.7. 可编程差分输出电压 2.3.8. 可编程电流强度
2.4. Intel® Stratix® 10 器件的片上I/O匹配 x
2.4.1. Intel® Stratix® 10 器件中无校准的RS OCT 2.4.2. Intel® Stratix® 10 器件中带校准的RSOCT 2.4.3. Intel® Stratix® 10 器件中带校准的RT OCT 2.4.4. 动态OCT 2.4.5. 差分输入（RD OCT） 2.4.6. Intel® Stratix® 10 器件中的OCT校准模块
2.5. Intel® Stratix® 10 器件的外部I/O匹配 x
2.5.1. 单端I/O匹配 2.5.2. Intel® Stratix® 10 器件的差分I/O匹配
2.5.2. Intel® Stratix® 10 器件的差分I/O匹配 x
2.5.2.1. Differential HSTL、SSTL、HSUL和POD匹配 2.5.2.2. LVDS、RSDS和Mini-LVDS匹配 2.5.2.3. LVPECL匹配
3. Intel® Stratix® 10 I/O设计考量 x
3.1. 指南：VREF源和VREF管脚 3.2. 指南：观察3.0 V对接的器件绝对最大额定值 3.3. 指南：基准电压和非基准电压I/O标准 3.4. 指南：上电排序期间不可驱动I/O管脚 3.5. 指南：最大DC电流限制
4. Intel® Stratix® 10 I/O实现指南 x
4.1. GPIO Intel® FPGA IP 4.2. 验证资源利用率和设计性能 4.3. GPIO时序 4.4. GPIO IP核设计实例 4.5. 验证管脚移植兼容性 4.6. IP移植到GPIO IP核
4.1. GPIO Intel® FPGA IP x
4.1.1. GPIO IP核数据路径 4.1.2. 寄存器封装
4.1.1. GPIO IP核数据路径 x
4.1.1.1. 输入路径 4.1.1.2. 输出或输出使能路径
4.3. GPIO时序 x
4.3.1. 时序组件 4.3.2. 延迟单元 4.3.3. 时序分析 4.3.4. 时序收敛指南
4.3.3. 时序分析 x
4.3.3.1. 单数据速率输入寄存器 4.3.3.2. 全速率或半速率DDIO输入寄存器 4.3.3.3. 单数据速率输出寄存器 4.3.3.4. 全速率或半速率DDIO输出寄存器
4.4. GPIO IP核设计实例 x
4.4.1. GPIO可综合 Intel® Quartus® Prime设计实例 4.4.2. GPIO IP核仿真设计实例
4.6. IP移植到GPIO IP核 x
4.6.1. 移植您的ALTDDIO_IN、ALTDDIO_OUT、ALTDDIO_BIDIR和ALTIOBUF IP核 4.6.2. 指南：交换已移植IP中的datain_h和datain_l端口
5. GPIO Intel® FPGA IP参考 x
5.1. GPIO Intel® FPGA IP参数设置 5.2. GPIO Intel® FPGA IP接口信号
5.2. GPIO Intel® FPGA IP接口信号 x
5.2.1. 共享信号 5.2.2. 数据接口的数据比特顺序 5.2.3. 数据接口信号和相应的时钟
1. Intel® Stratix® 10 I/O概述
2. Intel® Stratix® 10 I/O体系结构和功能
3. Intel® Stratix® 10 I/O设计考量
4. Intel® Stratix® 10 I/O实现指南
5. GPIO Intel® FPGA IP参考
6. Intel Stratix 10通用I/O用户指南存档
7. Intel® Stratix® 10通用I/O用户指南文件修订历史

2.1.2. Intel® Stratix® 10 I/O标准电压电平支持

所有封装中的 Intel® Stratix® 10器件都可与不同电源电压的系统对接。
  • I/O缓冲器由VCC、VCCPT和VCCIO供电。
  • 每个I/O bank都有其自身的VCCIO供电，且仅支持一个VCCIO电压。
  • 所有I/O bank中，除2.5 V和3.0 V以外，可使用任何所列VCCIO电压。
  • 所有I/O bank中，除2.5 V和3.0 V以外，可使用任何所列VCCIO电压。
  • 仅3 V I/O bank上支持2.5 V和3.0 V VCCIO电压。
  • 关于支持的最大和最小输入电压，请参阅器件数据表。
表 3.   Intel® Stratix® 10 器件I/O标准电压电平该表格列出了 Intel® Stratix® 10 器件中每种可用I/O标准的典型电源。
I/O标准 VCCIO(V)

VCCPT(V)

(预驱动器电压)

VREF (V)

(输入基准电压)

VTT(V)

(板级匹配电压)
输入5。 输出
3.0 V LVTTL/3.0 V LVCMOS 3.0 3.0 1.8 — —
2.5 V LVCMOS 3.0/2.5 2.5 1.8 — —
1.8 V LVCMOS 1.8 1.8 1.8 — —
1.5 V LVCMOS 1.5 1.5 1.8 — —
1.2 V LVCMOS 1.2 1.2 1.8 — —
SSTL-18 Class I和Class II VCCPT 1.8 1.8 0.9 0.9
SSTL-15 Class I和Class II VCCPT 1.5 1.8 0.75 0.75
SSTL-15 VCCPT 1.5 1.8 0.75 0.75
SSTL-135 VCCPT 1.35 1.8 0.675 0.675
SSTL-125 VCCPT 1.25 1.8 0.625 0.625
SSTL-12 VCCPT 1.2 1.8 0.6 0.6
POD12 VCCPT 1.2 1.8 0.84 1.2
1.8 V HSTL Class I和Class II VCCPT 1.8 1.8 0.9 0.9
1.5 V HSTL Class I和Class II VCCPT 1.5 1.8 0.75 0.75
1.2 V HSTL Class I和Class II VCCPT 1.2 1.8 0.6 0.6
HSUL-12 VCCPT 1.2 1.8 0.6 —
Differential SSTL-18 Class I and Class II VCCPT 1.8 1.8 — 0.9
Differential SSTL-15 Class I and Class II VCCPT 1.5 1.8 — 0.75
Differential SSTL-15 VCCPT 1.5 1.8 — 0.75
Differential SSTL-135 VCCPT 1.35 1.8 — 0.675
Differential SSTL-125 VCCPT 1.25 1.8 — 0.625
Differential SSTL-12 VCCPT 1.2 1.8 — 0.6
Differential POD12 VCCPT 1.2 1.8 — 1.2
Differential 1.8 V HSTL Class I and Class II VCCPT 1.8 1.8 — 0.9
Differential 1.5 V HSTL Class I and Class II VCCPT 1.5 1.8 — 0.75
Differential 1.2 V HSTL Class I and Class II VCCPT 1.2 1.8 — 0.6
Differential HSUL-12 VCCPT 1.2 1.8 — —
LVDS VCCPT 1.8 1.8 — —
Mini-LVDS VCCPT 1.8 1.8 — —
RSDS VCCPT 1.8 1.8 — —
LVPECL (仅差分时钟输入) VCCPT — 1.8 — —
相关信息
5 SSTL、HSTL、Differential SSTL、Differential HSTL, POD、Differential、LVDS、RSDS、Mini-LVDS、LVPECL、HSUL和Differential HSUL的输入均由VCCPT供电
二级标题