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2.3.1. 评估可用HPS IP
HPS体系结构集成了各种外设功能,从而减小了电路板尺寸并提高了系统内性能。在评估FPGA内核的软IP之前,先识别出可用于节省FPGA I/O的HPS外设:
- EMACs
- USB Controllers
- I2C Conctrollers
- UARTs
- SPI Master Controllers
- SPI Slave Controllers
- GPIO Interfaces
有关评估可用HPS IP的更多信息,请参阅 Intel® Agilex™ 硬核处理器系统技术参考手册。