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Ixiasoft
1. 系统调试工具概述
2. 使用System Console分析和调试设计
3. 调试收发器链路
4. 使用Signal Probe的快速设计调试
5. 使用Signal Tap逻辑分析仪进行设计调试
6. 使用外部逻辑分析器进行在系统调试(In-System Debugging Using External Logic Analyzers)
7. 存储器和常量的在系统修改(In-System Modification of Memory and Constants)
8. 使用In-System Sources and Probes进行设计调试
A. Intel® Quartus® Prime Standard Edition用户指南
2.1. System Console简介
2.2. System Console调试流程
2.3. 与System Console交互的IP内核
2.4. 启动System Console
2.5. System Console GUI
2.6. System Console命令
2.7. 在命令行模式下运行System Console
2.8. System Console服务
2.9. 使用工具包
2.10. ADC Toolkit
2.11. System Console示例和教程
2.12. 板载 Intel® FPGA Download Cable II支持
2.13. 系统验证流程中的MATLAB*和Simulink*
2.14. 不推荐使用的命令
2.15. 使用System Console分析和调试设计修订历史
2.9.6.4.1. toolkit_register
2.9.6.4.2. toolkit_open
2.9.6.4.3. get_quartus_ini
2.9.6.4.4. toolkit_get_context
2.9.6.4.5. toolkit_get_types
2.9.6.4.6. toolkit_get_properties
2.9.6.4.7. toolkit_add
2.9.6.4.8. toolkit_get_property
2.9.6.4.9. toolkit_set_property
2.9.6.4.10. toolkit_remove
2.9.6.4.11. toolkit_get_widget_dimensions
2.9.6.5.1. 小部件类型和属性
2.9.6.5.2. barChart属性
2.9.6.5.3. 按钮属性
2.9.6.5.4. checkBox属性
2.9.6.5.5. comboBox属性
2.9.6.5.6. 表盘属性(dial Properties)
2.9.6.5.7. fileChooserButton属性
2.9.6.5.8. group属性
2.9.6.5.9. label属性
2.9.6.5.10. led属性
2.9.6.5.11. lineChart属性
2.9.6.5.12. list属性
2.9.6.5.13. pieChart属性
2.9.6.5.14. table属性
2.9.6.5.15. text属性
2.9.6.5.16. textField Properties
2.9.6.5.17. timeChart Properties
2.9.6.5.18. xyChart属性
4.2.1. 生成一个Signal Probe管脚
4.2.2. 删除一个Signal Probe管脚
4.2.3. 使能一个Signal Probe管脚
4.2.4. 禁用一个Signal Probe管脚
4.2.5. 执行一个Signal Probe编译
4.2.6. 保留Signal Probe管脚
4.2.7. 添加Signal Probe源
4.2.8. 分配I/O标准
4.2.9. 添加寄存器用于流水线(pipelining)
4.2.10. 完整编译后立即运行Signal Probe
4.2.11. 手动运行Signal Probe
4.2.12. 使能或禁用所有Signal Probe布线
4.2.13. 允许Signal Probe修改Fitting结果
5.1. Signal Tap逻辑分析仪
5.2. Signal Tap Logic Analyzer任务流程概述
5.3. 配置Signal Tap Logic Analyzer
5.4. 定义触发器
5.5. 编译设计
5.6. 对目标器件或者器件编程
5.7. 运行Signal Tap Logic Analyzer
5.8. 查看,分析和使用采集的数据
5.9. 其他功能
5.10. 设计实例:使用Signal Tap Logic Analyzers
5.11. 自定义触发流程应用示例
5.12. Signal Tap脚本支持
5.13. 使用Signal Tap Logic Analyzer进行设计调试修订历史
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1.1.1. 系统调试工具比较
工具 | 描述 | 典型使用 |
---|---|---|
System Console |
|
您需要执行系统级调试。 例如,如果您有一个 Avalon® -MM slave或者 Avalon® -ST接口,那么您可以在传输级上调试设计。 |
Transceiver Toolkit |
|
您需要在完成设计之前调试或优化电路板布局的信号完整性。 |
Signal Tap Logic Analyzer |
|
您有备用的片上存储器,并且希望对硬件中运行的设计进行功能验证。 |
Signal Probe | 以递增方式将内部信号布线到I/O管脚,同时保留最后一次进行布局布线的设计结果。 | 您有备用I/O管脚,并且想使用外部逻辑分析仪或示波器检查一小组控制管脚脚的操作。 |
Logic Analyzer Interface (LAI) |
|
您有需要使用外部逻辑分析仪进行验证的有限片上存储器和大量内部数据总线。逻辑分析仪供应商(例如Tektronics*和Agilent*)提供与此工具的集成,以提高可用性。 |
In-System Sources and Probes | 提供使用JTAG接口将逻辑值驱动到内部节点和从内部节点采样逻辑值的简便方法。 | 您想使用带虚拟按钮的前面板对FPGA进行原型设计。 |
In-System Memory Content Editor | 显示并允许您编辑片上存储器。 | 您想对未连接到 Nios® II处理器的片上存储器的内容进行查看和编辑。 当您不想在系统中有 Nios® II调试内核时,您也可以使用此工具。 |
Virtual JTAG Interface | 使您能够与JTAG接口进行通信,以便开发自定义应用程序。 | 您想要与设计中的自定义信号进行通信。 |