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2.5.2. OSC_CLK_1时钟输入
OSC_CLK_1要求
当通过一个外部时钟源驱动OSC_CLK_1输入时钟,并在 Intel® Quartus® Prime软件中使能OSC_CLK_1时,器件会加载大部分的250 MHz配置比特流。除了OSC_CLK_1(以170-230 MHz运行配置进程), Intel® Stratix® 10器件还包括一个内部振荡器。 Intel® Stratix® 10 器件总是使用此内部振荡器对比特流的第一个部分(大约200 kilobyte (KB))进行加载。SDM可使用任何一种时钟源进行剩下的器件配置。如果使用内部振荡器,那么OSC_CLK_1可保持在未连接状态。
当选择OSC_CLK_1作为配置的时钟源时,在以下情况下器件配置可能会失败:l
- 无法驱动OSC_CLK_1管脚。
- 以不正确的频率驱动OSC_CLK_1管脚。选择以下其中一个输入参考时钟频率驱动OSC_CLK_1管脚:
- 25 MHz
- 100 MHz
- 125 MHz
Intel® Stratix® 10器件增加OSC_CLK_1源时钟频率以生成一个250 MHz时钟用于配置。使用OSC_CLK_1源可以实现最快的可能配置。关于使用 Intel® Quartus® Prime软件设置此频率的说明,请参考Setting Configuration Clock Source。
# EXTERNAL OSCILLATOR CLOCK VIA OSC_CLK_1 PIN set_global_assignment -name DEVICE_INITIALIZATION_CLOCK OSC_CLK_1_25MHZ set_global_assignment -name DEVICE_INITIALIZATION_CLOCK OSC_CLK_1_100MHZ set_global_assignment -name DEVICE_INITIALIZATION_CLOCK OSC_CLK_1_125MHZ
在不对器件进行循环上电的情况下进行重配置的配置时钟要求
当对配置指定OSC_CLK_1,在不断电 Intel® Stratix® 10器件的情况下进行重配置时,器件只能使用 OSC_CLK_1进行重配置。在此情况下,OSC_CLK_1必须是一个自由运行的时钟。
对器件进行循环上电后配置的配置时钟要求
断电后,当对配置指定OSC_CLK_1时, Intel® Stratix® 10器件使用内部振荡器加载比特流的第一部分,使用OSC_CLK_1加载比特流的其余部分。