F-Tile动态重配置设计示例用户指南

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ID 710582
日期 3/28/2022
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文档目录
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1. 快速入门指南 2. CPRI多速率设计示例的详细说明 3. Ethernet多速率设计示例的详细说明 4. PMA/FEC Direct PHY Multirate设计示例的详细说明 5. F-Tile动态重配置设计示例用户指南的归档 6. F-Tile动态重配置设计示例用户指南文档修订历史
1. 快速入门指南 x
1.1. 硬件和软件要求 1.2. 生成设计 1.3. 目录结构 1.4. 编译Compilation-Only(仅编译)工程 1.5. 仿真设计示例测试台 1.6. 在硬件中编译和配置设计示例 1.7. 测试硬件设计示例
1.2. 生成设计 x
1.2.1. CPRI多速率设计示例参数 1.2.2. Ethernet多速率设计示例参数 1.2.3. PMA/FEC Direct PHY多速率设计示例参数
2. CPRI多速率设计示例的详细说明 x
2.1. CPRI多速率设计示例：功能描述 2.2. CPRI多速率设计示例：寄存器
2.1. CPRI多速率设计示例：功能描述 x
2.1.1. CPRI多速率设计示例：仿真测试台 2.1.2. CPRI多速率硬件设计示例 2.1.3. CPRI多速率设计示例：复位方案(reset scheme)
3. Ethernet多速率设计示例的详细说明 x
3.1. Ethernet多速率设计示例：功能描述 3.2. Ethernet多速率设计示例：寄存器
3.1. Ethernet多速率设计示例：功能描述 x
3.1.1. Ethernet多速率设计示例：仿真测试台 3.1.2. Ethernet多速率硬件设计示例
4. PMA/FEC Direct PHY Multirate设计示例的详细说明 x
4.1. PMA/FEC Direct PHY Multirate设计示例：功能描述 4.2. PMA/FEC Direct PHY多速率设计示例：寄存器
4.1. PMA/FEC Direct PHY Multirate设计示例：功能描述 x
4.1.1. PMA/FEC Direct PHY Multirate设计示例：仿真测试台
1. 快速入门指南
2. CPRI多速率设计示例的详细说明
3. Ethernet多速率设计示例的详细说明
4. PMA/FEC Direct PHY Multirate设计示例的详细说明
5. F-Tile动态重配置设计示例用户指南的归档
6. F-Tile动态重配置设计示例用户指南文档修订历史

2.1.2. CPRI多速率硬件设计示例

图 7. CPRI多速率硬件设计示例结构图

在硬件设计示例中，示例设计中的数据包客户端，F-Tile CPRI PHY Multirate Intel® FPGA IP和F-Tile Dynamic Reconfiguration Suite Intel Intel® IP的复位，状态和控制信号连接到In-System Sources and Probes IP (ISSP)。硬件测试脚本打开ISSP服务，读取和设置值。一个JTAG host被例化以访问 Avalon® memory-mapped interface。

设计示例的硬件流程：
  1. 使能数据包往返测量(packet round-trip measurement)。
    • 执行确定性延迟测试流程。
    • 将确定性延迟数据打印到det_latency.log文件。
  2. 根据profile 0 (24G RSFEC)对CPRI PHY Multirate IP DUT进行上电。
  3. 根据上电配置文件(power-up profile)对测试台变量进行初始化。这些变量是：
    • cpri_speed：表示当前配置文件(profile)的速度。
    • enable_rsfec：表示对当前配置文件(profile)是使能还是禁用RS-FEC。
    • current_dr_profile：表示当前配置文件(profile)的ID。
  4. 执行动态重配置。
  5. 检查测试台错误标志(error flag)并确定测试台是通过了还是失败了。动态重配置流量测试之后，如果有任何错误，那么此错误标志被设为1。
若要进行自定义(customization)测试，您可以通过修改src或参数文件中的DR_TRANSITION数组变量对测试流程进行配置。profile ID被传递到Dynamic Reconfiguration IP以配置原定的动态重配置任务。
  • DR_TRANSITION: 原定的动态重配置序列数组。此数组变量的大小决定了要执行的动态重配置的数量。
例如，若要实现动态重配置序列(Dynamic Reconfiguration sequence): 24G RS-FEC > 10G > 4.9G。此数组变量设置为： 
set DR_TRANSITION(0)   "10G"
set DR_TRANSITION(1)   " 4P9G"
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