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Ixiasoft
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当SD Interface Bit Width参数选项设置到20时,该子模块被使能。该子模块根据进一步处理的要求将20位SD并行数据转换还原成10位。
该子模块包含一个时钟使能生成器在tx_pclk域每第11个时钟周期生成两个数据有效脉冲。每次数据有效信号被置位后,该块将交替输出SD 20-bit接口数据的低10位和高10位到下游逻辑。