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4.9.2.2. 生成IP功能仿真模型( Intel® Quartus® Prime Standard Edition)
Intel为一些支持40nm FPGA器件的 Intel® FPGA IP提供IP功能仿真模型。
要生成IP功能仿真模型:
- 请在参数化IP核时开启Generate Simulation Model选项。
- 仿真设计时,请仅对仿真器中用于IP核的.vo或.vho进行编译。切勿编译相应HDL文件。加密HDL文件仅支持通过 Intel® Quartus® Prime软件的综合。
注:
- Intel® FPGA IP核的仿真无需IP功能仿真模型,因而IP核参数编辑器中不会提供Generate Simulation Model选项。
- 最近发布的许多 Intel® FPGA IP核支持RTL仿真,使用的是IEEE Verilog HDL加密。IEEE加密模型显著快于IP功能仿真模型。可仿真Verilog HDL和VHDL设计中的模型。